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2094-XNLIM-2 | 线路接口模块 每个PIF提供多个UTOPIA接口

 2094-XNLIM-2线路接口模块是网络设备中的重要组件,它通常包含多个线路收发单元和一个共有的接口适配单元(PIF),此外还可能有时序逻辑电路、告警指示电路等。每个线路收发单元中包括光电/电光转换电路以及SONET帧的组装/分解电路。

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产品详情

2094-XNLIM-2   |   线路接口模块   每个PIF提供多个UTOPIA接口

2094-XNLIM-2.png

描述

品牌:A-B

型号: 2094-XNLIM-2

品名:线路接口模块

艾伦-布拉德利

线路接口模块, 用于 2094-ALxxS、2094-BLxxS、2094-XL75S-CX

线路接口模块,包括 I/O (IOL)、VAC 线路 (IPL)、VAC 负载 (OPL)、控制电源 (CPL)、230 伏辅助输出 (P2L)、24 伏直流制动电源 (P1L) 和 230 伏交流辅助输入 (APL) 替换连接器

 2094-XNLIM-2线路接口模块是网络设备中的重要组件,它通常包含多个线路收发单元和一个共有的接口适配单元(PIF),此外还可能有时序逻辑电路、告警指示电路等。每个线路收发单元中包括光电/电光转换电路以及SONET帧的组装/分解电路。


具体来说, 2094-XNLIM-2每个PIF提供多个UTOPIA接口,分别与每个线路收发单元相连,为线路收发单元和交换内核之间提供接口适配功能。PIF的MBUF接口以串行信号向MBUF提供信元的净荷信息,而PIF的交换控制器接口以串行信号向交换控制器提供信元的信头信息。物理层单元的CPU总线接口使得CPU能够对物理层单元进行初始化及读取线路接口的状态信息。

2094-XNLIM-2.png

Description

Brand: A-B

Model: 2094-XNLIM-2

Product name: Line interface module

Alan Bradley

Line interface module for 2094-ALxxS, 2094-BLxxS, 2094-XL75S-CX

The line interface module includes I/O (IOL), VAC Line (IPL), VAC Load (OPL), Control power Supply (CPL), 230 Volt auxiliary output (P2L), 24 volt DC Brake Power Supply (P1L), and 230 volt AC Auxiliary Input (APL) replacement connectors

The 2094-XNLIM-2 Line interface module is an important component in a network device, which usually contains multiple line transceiver units and a common interface adaptation unit (PIF), in addition to which there may be sequential logic circuits, alarm indicating circuits, etc. Each line transceiver unit includes photoelectric/electro-optical conversion circuit and assembly/decomposition circuit for SONET frames.


Specifically, the 2094-XNLIM-2 provides multiple UTOPIA interfaces per PIF that are connected to each line transceiver unit to provide interface adaptation between the line transceiver unit and the switching kernel. The MBUF interface of PIF provides the net load information of the cell to the MBUF by serial signal, while the switching controller interface of PIF provides the header information of the cell by serial signal to the switching controller. The CPU bus interface of the physical layer unit enables the CPU to initialize the physical layer unit and read the status information of the line interface.

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